三态门、OC门的设计与仿真实验报告.doc

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2020-10-09 发布于四川
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三态门、OC门的设计与仿真实验报告.doc

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三态门的设计与仿真实验报告一、实验内容 1、用逻辑图和VHDL语言设计三态门，三态门的使能端对低电平有效。 2、应用MaxplusII软件对三态门和OC门进行编译、仿真和模拟。 3、在“MaxplusII软件的基本操作”实验的基础上，能更加熟练的掌握应用MaxplusII软件，从而更形象更深层次的理解三态门和OC门。二、实验平台及实验方法用VHDL语言编写三态门和OC门的程序，运用Maxplus软件进行仿真，再结合FPGA（即对实验箱的芯片进行编译）进行验证。也可以用原理图进行文本设计，波形设计。逻辑符号图：真值表： EN A OUT 0 0 HI-Z 0 1 HI-