明德扬课件-用门逻辑代替乘法器并实现流水练习思路.pdfVIP

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2020-10-29 发布于广东
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明德扬课件-用门逻辑代替乘法器并实现流水练习思路.pdf

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明德扬点拨 ·FPGA之科技.教育用门逻辑代替乘法器并实现流水练习思路点透学习误区拨出设计精髓主讲：潘文明明德扬科技教育ASIC/FPGA教育明德扬科教 QQ群：官网：淘宝：明德扬科技教育ASIC/FPGA教育课程大纲 1. 功能要求 2. 设计思路 3. 代码设计明德扬科技教育ASIC/FPGA教育一、功能要求明德扬科技教育ASIC/FPGA教育二、设计思路 1. 设计时要从输出信号倒推，现有条件不能直接得到的信号，先假设信号再设计； 2. 一个一个信号设计，逐个击破明德扬科技教育ASIC/FPGA教育三、设计思路—如何代替加法器？ 1. 如何用门逻辑代替加法器？ 2. 最简单：1位加法器，信号有cin, a, b, sum, cout(列真值表) cin a b sum cout cin a b sum cout 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 1 0 1 0 1 0 1 0 1 1 0 0 1 0 1 1 0 1 1 1 1 1 1 sum cinab cinab cinab cinab 001010 100111 cout cinab cinab cinab cinab 011101110111 明德扬科技教育ASIC/FPGA教育三、设计思路—卡诺图化简 sum cinab cinab cinab cinab 001010 100111 cout cinab cinab cina