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- 2020-11-19 发布于上海
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;5.4 VHDL文本输入设计方法初步;5.4.1 编辑输入并保存VHDL源文件;图5-13 在文本编辑窗中输入VHDL文件并存盘;文件存盘后,
关键词将改变
颜色!否则文
件名一定有错!;5.4.2 将当前设计设定为工程;注意,此路径指
向当前的工程!;首先选择这里;选择编译器;5.4.3 选择VHDL文本编译版本号和排错;选择此项;编译出错!;5.4.3 选择VHDL文本编译版本号和排错;错误所在;改正错误;完成编译!;首先选择此项,
为仿真测试新
建一个文件;从SNF文件中
输入设计文件
的信号节点;SNF文件中
的信号节点;消去这里的勾,
以便方便设置
输入电平;选择END TIME
调整仿真时间
区域。;用此键改变仿真
区域坐标到合适
位置。;设置输入信号‘a’
的周期为2us;仿真波形文件
存盘!;选择仿真器;5.4.4 时序仿真;引脚锁定;键8的引脚名
作为“s”信号;扬声器引脚号
为:99;信号b由
“clock0”输入
时钟信号,
引脚号为:
126; 引脚对应情况
实验板位置 多路选择器信号 通用目标器件引脚名 目标器件EP1K30TC144引脚号
1、键8: s PIO13 27
2、扬声器 y SPEAKER 99
3、时钟输入信号 b CLOCK0 126
4、时钟输入信号 a CLOCK5 56
;选择引脚
锁定选项;此处输入
信号名;再编译一次,
将引脚信息
进去;选择编程器,
准备将设计
好的半加器
文件下载到目
器件中去;在编程窗打开
的情况下选择
下载方式设置;下载(配置)
成功!
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