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数字逻辑实验报告
姓名 : 宁金龙
专业班级 :计算机 1012 班
学号 :U201014585
指导老师：
完成时间： 2012年 4 月 8 日
实验一：组合逻辑电路的设计
一、实验目的:
掌握组合逻辑电路的功能测试。
验证半加器和全加器的逻辑功能
学会二进制的运算规律。
、实验所用组件：
二输入四与门 74LS08二输入四与非门 74LS00二输入四异或门 74LS86六门反向器
74LS04芯片，三输入三与非门 74L10,电线若干。
三、实验内容:
内容A:全加全减器
实验要求:
一位全加/全减法器，如图所示:
接开关揍灯
接开关
S
Co
电路做加法还是做减法运算是由 M决定的，当M=0做加法，M=1做减法。当作为全加法起
时输入A.B和Cin分别为加数，被加数和低位来的进位， S和数，Co位向上位的进位。当作
为全减法器时输入信号 A,B和Cin分别为被减数，减数和低位来的借位， S为差，Co为向上
的借位。
实验步骤：
1 .根据功能写出输入/输出观察表:
SB
$傩制卜
A*
d
C（低桩进）
Fl（和卜
Fl（逬 ffifi）
0--
3
2 |
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3
g
「*
A
如
3
0
2
h
l-
3.做出卡诺图，确定输出和激励的函数表达式:
、\S基
BC\^
00
01 11 10
00
0
1
1
0
01
1
0
0
1
11
0
1
1
0
10
1
0
0
1
送殊我达式：F1-A?B?C
00
01 11 10
00
0
0
0
0
01
0
1
0
1
11
1
1
1
1
10
0
1
0
1
遷输荡达式：F2= BC-B(S(±)AC(S?A)
根据逻辑表达式作出电路的平面图：
检查导线以及芯片是否完好无损坏，根据平面图和逻辑表达式连接电路。
实验结果：
电路连接好后，经检测成功实现了一位全加 /全减法器的功能。
内容B :舍入与检测电路的设计：
试验要求：
用所给定的集合电路组件设计一个多输出逻辑电路， 该电路的输入为8421码，F1为“四
舍五入”输出信号，F2为奇偶检测输出信号。当电路检测到输入的代码大宇或等于（ 5） 10
时，电路的输出F仁1；其他情况F仁0。当输入代码中含1的个数为奇数时，电路的输出F2=1, 其他情况F2=0。该电路的框图如下所示：
A
摆开关B C D
摆开关
（1） 按照所设计的电路图接线，注意将电路的输入端接试验台的开关， 通过拨动开
关输入8421代码，电路输入按至试验台显示灯。
（2） 每输入一个代码后观察显示灯，并将结果记录在输入 /输出观察表中。
实验步骤
1.按照所给定的实验要求填写出 F1, F2理论上的真值表。
A
B
C
D
Fl
F2
0
0
0
0
0
0
0
0
0
1
0
1
0
0
1
0
0
1
0
0
1
1
0
0
0
1
0
0
0
1
0
1
0
1
1
0
0
1
1
0
1
0
0
1
1
1
1
1
1
0
0
0
1
1
1
0
0
1
1
0
2 .根据真值表给出F1和F2的卡诺图。
AB
CD
00
01
11
10
00
0
1
d
1
01
1
0
d
0
11
0
1
d
d
10
1
0
d
d
遅葫素迖式：F2-A?B十C十D
根据逻辑表达式画出电路的平面图:
18
菲门接开关检查导线和芯片是否完好无损坏，根据电路图和逻辑表达式连接电路。
菲门
接开关
波动开关输入8421代码，观察显示灯的状况并填写出实际的 F1, F2取值表，并与理 论值相对比，确定电路连接是否正确。
实验结果：
电路连接完成后，经检测成功实现舍入与检测电路的功能。
实验二：同步时序逻辑电路设计
实验目的：
掌握同步时序逻辑电路实验的设计方法， 验证所涉及的同步时序路逻辑电路， 对深对“同
步”和“时序”的理解。
实验器材：
双D触发器组件2片，型号为74LS74 负沿双JK触发器组件2片，型号为74LS73
二输入四与非门组件 2片，型号为74LS00 二输入四或非门组件 1片，型号为74LS02 三输入三与非门组件 1片，型号为74LS10二输入四异或门组件 1片，型号为74LS86 六门反向器组件2片，型号为74LS04
实验内容
内容A:
利用所给组件，设计一个同步模 4可逆计数器，框图如图所示:
二可逆计数器?y2
二可逆计数器
?y2
yi
实验步骤
i：画出该电路的状态图:
1/10/00/11/0
1/1
0/0
0/1
1/0
2 ?根据状态图做出状态表
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