基于fpga的数字下变频器的设计与实现.docVIP

基于FPGA的数字下变频器的设计与实现 导语：?设计和实现了基于FPGA的可编程数字下变频器（DDC），用于宽带数字中频软件无线电接收机中，主要完成了数字下变频、数据抽取等功能。 设计和实现了基于FPGA的可编程数字下变频器（DDC），用于宽带数字中频软件无线电接收机中，主要完成了数字下变频、数据抽取等功能。采用自顶向下的模块化设计方法，将整个下变频器划分为基本单元，实现这些功能模块并组成模块库。在具体应用时，优化配置各个模块来满足具体无线通信系统性能的要求。 数字下变频技术在移动通信、数字广播、电视等领域具有重要应用价值。在接收机中，信号经混频后，输出到低通滤波器，滤除倍频分量和带外信号。但随着采样速率的提高，一个重要问题就是采样后的数据流速率很高，导致后续的信号处理速度跟不上，特别是对有些同步解调算法，其计算量巨大［1］。数据吞吐率过高很难满足实时性要求，因此有必要对A/D转换后的数据流进行降速处理。 数字下变频的基本功能是从输入的宽带高速数据流信号中提取所需的窄带信号，将其下变频为数字基带信号，并转换成较低的数据流［2］。高速ADC的输出信号送入至数字下变频器内，然后与数字本振正交混频，再经带通滤波器，滤除其他干扰信号，然后再进行信号的解调、解码处理。如果直接对混频后的数据进行带通滤