Functional Verification of a Multiple-issue, Out-of-Order, Superscalar Alpha Processor—The DEC Alpha 21264 Microprocessor微处理器的多问题、无序、超标量Alpha处理器的功能验证.pdfVIP

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2021-08-05 发布于辽宁
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Functional Verification of a Multiple-issue, Out-of-Order, Superscalar Alpha Processor—The DEC Alpha 21264 Microprocessor微处理器的多问题、无序、超标量Alpha处理器的功能验证.pdf

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Functional Verification of a Multiple-issue, Out-of-Order, Superscalar Alpha Processor— The DEC Alpha 21264 Microprocessor Scott Taylor, Michael Quinn, Darren Brown, Nathan Dohm, Scot Hildebrandt, James Huggins, Carl Ramey Digital Equipment Corporation ABSTRACT In addition, on-chip caches include a 64-KByte virtually- DIGITAL’s Alpha 21264 processor is a highly out-of-order, indexed/virtually-tagged two-way set predicting instruction superpipelined, superscalar implementation of the Alpha cache and a 64-KByte virtually-indexed/physically-tagged two- architecture, capable of a peak execution rate of six instructions way set associative data cache. Each cache is paired with its per cycle and a sustainable rate of four per cycle. The 21264 own 128-entry fully associative instruction address translation also features a 500 MHz clock speed and a high-bandwidth buffer, and the data cache also features cache-hit prediction system interface that channels up to 5.3 Gbytes/second of cache logi