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数 字 系 统 的 设 计 与 实 验
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指导老师
2013 年 12 月 10 日
实验一 原码反码发生器
一 实验目的:
1、 掌握组合逻辑电路的基本设计方法。
2 、 学习波形仿真的方法。
3 、 加深对最简单的二进制原码、反码的理解,灵活运用基本的逻辑门。
二 实验内容
1、设计的电路应具备以下功能:
A.包含如下端口:
一个选择信号端口,一个 8 位二进制输入端口,一个原码 / 反码输出端口。
B . 选择信号的逻辑状态为 0 时输出原码;逻辑状态为 1 时输出反码。
2、完成电路设计。
3、对设计的正确性进行验证。
三 实验要求
1、列出所要实现的功能的真值表。
输入端口 输出端口
cin( 十六进制 ) Fin cout
01H 0 01H
02H 1 FDH
03H 0 03H
04H 1 FBH
05H 0 05H
06H 1 F9H
07H 0 07H
08H 1 F7H
2、画出电路的逻辑图。
3、编写用 VHDL语言描述的源程序。
library ieee;
use ieee.std_logic_1164.all;
entity shiyan1 is
port (cin : in std_logic_vector(7 downto 0);
fin : in std_logic;
cout: out std_logic_vector(7 downto 0));
end shiyan1;
architecture behave of shiyan1 is
begin
process(fin)
begin
case fin is
when 1 = cout = not cin;
when 0 = cout = cin;
when others = null;
end case;
end process;
end behave;
4 、 在 MAX软件平台上完成编译和功能仿真。
一
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