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- 2022-04-23 发布于浙江
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FPGA乘法器浮点运算
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乘法器
两种实现⽅式，DSP Slice或组合逻辑， 者速度⾼，不 占⽤逻辑资源，后者⼀般⽤于⼩位宽运算，延迟⼩。下⾯是采⽤默认的Blocking模
式，Medium Usage，tready在输⼊⼀个数之后拉低了，导致第⼆排数据输⼊失败，
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