数字逻辑设计第7章 Sequential Logic Design Principles.pptVIP

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2022-05-09 发布于安徽
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数字逻辑设计第7章 Sequential Logic Design Principles.ppt

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对应的Moore机的状态表和状态图 * Timing diagram Moore机的输出只与状态有关 Mealy机的输出不仅与状态有关，还与输入有关 * State-Machine Structure 下一状态逻辑 F 状态存储器时钟输出逻辑 G 输入输出时钟信号激励当前状态激励：F（当前状态，输入）输出：G（当前状态，输入）组合电路状态存储器：由激励信号得到下一状态激励方程驱动方程输出方程转移方程 ——状态机结构 * EX2： 1、excitation equations： D1 = X D2 = Q1 D3 = Q2 2、output equations: Y = Q3 3、transition equations： Q1*=D1 = X Q2*=D2 = Q1 Q3*=D3 = Q2 D1 D2 D3 * 2. output equations ： Y = Q3 3、转移方程： Q1* = X Q2* = Q1 Q3* = Q2 3、transition equations： Q1* = X Q2* = Q1 Q3* = Q2 移位寄存器 (shift register) Q1*Q2*Q3*, Y Q1Q2Q3 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 X 0 1 000, 0 000, 1 001, 0 001, 1 010, 0 010, 1 011, 0 011, 1 100, 0 100, 1 101, 0 101, 1 110, 0 110, 1 111, 0 111, 1 0 1 0 1 0 1 1 Transition/output table： * Scan Flip-Flop D Q CLK Q D TE CLK Q QL TI TE = 0 ? 正常操作 Q=D TE = 1 ? 进入测试模式 Test enable input ? Test input ? D TE TI CLK Q Q Logic symbol * TE = 0 ? 正常操作 TE = 1 ? 进行测试每个触发器的输出端Q都与后一个触发器的TI端连接 TIN 端扫入一组测试向量（需若干个时钟触发沿）再经过若干个时钟的正常操作（TE=0）可以在TO端观察（扫出）电路的新状态 TIN CLK TE TO * EX3：State machine with J-K Flip-Flops Q0 Q1 J0 K0 J1 K1 Z = X·Q0·Q1+Y·Q0’·Q1’ J0 = X·Y’ K0= X·Y’+Y·Q1 J1 = X·Q0+Y K1 = Y·Q0’+X·Y’·Q0 1、excitation equation: 2、output equations: * 3、transition equations: J-K触发器特征方程为：Q* = J·Q’ + K’·Q Q0* = J0· Q0’ + K0’· Q0 = (X·Y’) · Q0’ + (X·Y’+Y·Q1 )’· Q0 J0 = X·Y’ K0= X·Y’+Y·Q1 J1 = X·Q0+Y K1 = Y·Q0’+X·Y’·Q0 1、excitation equations: = X·Y’·Q0’ + X’·Y’·Q0+X’·Q1’·Q0+ Y·Q1’·Q0 Q1* = J1· Q1’ + K1’· Q1 = (X·Q0+Y)· Q1’ + (Y·Q0’+X·Y’·Q0)’· Q1 = X·Q1’·Q0+Y·Q1’+ X’·Y’·Q1+Y’·Q1·Q0’+X’·Q1·Q0+ Y·Q1·Q0 * 4、transition equations: 0 0 0 1 1 0 1 1 00 , 0 01 , 0 10 , 0 11 , 0 10 , 1 11 , 0 00 , 0 10 , 1 Q1Q0 XY 00 01 10 11 Q1*Q0*, Z Q0*= X·Y’·Q0’ + X’·Y’·Q0+X’·Q1’·Q0+ Y·Q1’·Q0 Q1*= X·Q1’·Q0+Y·Q1’+ X’·Y’·Q1+Y’·Q1·Q0’+X’·Q1·Q0+ Y·Q1