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码流综合测试仪视频流监测的FPGA设计与实现 导师：黄 俊 副教授学生：万志卫 学号：S080101114 专业：通信与通信系统01研究背景及选题意义02视频码流服务质量监测标准03系统总体设计04FPGA功能模块的设计与实现05仿真验证及工作总结论文主要内容/27研究背景及选题意义1/27三网融合 势在必行，已经进入实质阶段。保障体系多媒体业务服务质量和体验质量指标监测。便携式或手持式、低成本、多制式。国内外现状选题背景/272视频码流服务质量监测标准/27流媒体系统架构 /27 视频流QoS分类模型 内容质量传输质量用户互动质量视频流质量连续性错误PCR抖动PSI表格错误IP丢包率IP抖动RTP丢包率RTP抖动TCP/UDP重传节目源品质PCR抖动错误指示计数业务提供IGMP延时RTSP延时视频码流服务质量监测标准1、视频传输质量（MDI）2、三级告警测试（TR 101 290 ）/27系统总体设计33/27FPGA+ARMDSPSOPC1、适合处理复杂算法、控制能力弱。2、处理速度快但不能并行处理。3、无法提供友好的用户界面。4、开发和调试工具还不完善1、系统的集成度高。2、 CPU普遍是采用IP软核来实现，其接口性能差、功能有限。3、IP硬核性能好，但成本高。4、功耗大，源码不公开。1、ARM处理器拥有很好的控制能力、支持友好界面。2、FPGA可以快速的并行数据处理。3、FPGA功耗大。4、系统开发难度大。系统总体方案论证/27FPGA功能模块的设计与实现4/27FPGA功能模块的设计与实现1、FPGA总体设计/27FPGA功能模块的设计与实现2、数据采集模块三态以太网MAC软核用户数据发送接口物理层/27FPGA功能模块的设计与实现3、FIFO缓存模块写数据读数据复位复位读地址写地址读时钟写时钟空标志满标志/27FPGA功能模块的设计与实现3、FIFO缓存模块—空/满标志产生逻辑 写时钟满标志写地址空标志如何消除亚稳态？/27FPGA功能模块的设计与实现4、以太网MEPG-2 TS包提取 MACIPUDPRTPTS/27FPGA功能模块的设计与实现5、MEPG-2 TS码流错误检测—同步检测 /27FPGA功能模块的设计与实现5、MEPG-2 TS码流错误检测PAT错误检测原理PMT错误检测原理/27单次丢包数丢包总数FPGA功能模块的设计与实现6、媒体传输指标MDI指标提取—媒体丢包率MLR计算1、延迟因素DF2、媒体丢包率MLR/27根目录一级子目录二级子目录FPGA功能模块的设计与实现7、PSI信息提取PSI信息提取：1、PAT信息提取2、PMT信息提取/275=仿真验证及工作总结5/27仿真验证1、以太网MAC软核测试 /27仿真验证2、 FIFO仿真 2、只读不写3、正常读写1、只写不读/27仿真验证3、 数据校验 IP数据报首部校验时序图 8位并行数据CRC32检验时序图 /27仿真验证4、 PAT检测与分析/27仿真验证5、 PMT检测与分析/27工作总结 本文已完成的主要工作 通过系统方案论证，完成了软硬件平台主体方案的设计。完成了数据采集、FIFO缓存模块以及MEPG-2 TS码流监测的FPGA功能模块的设计与实现。 未来工作展望详细分析错误告警事件信息，能通过相关操作对简单的错误进行纠正，而不仅仅是检错。 软件代码的优化。提高测试仪的响应速度和处理效率，充分高效的使用FPGA资源。/27Thank You !各位老师、同学，大家好，我的答辩题目是码流综合测试仪视频流监测的FPGA设计与实现下面将从以下5个方面来讲述本文的主要工作：首先介绍课题的研究背景和选题意义，其次，分析视频码流服务质量监测标准 ，然后，提出系统的整体设计方案，重点阐述的内容是FPGA功能模块的设计与实现 ，最后对FPGA的实现进行仿真验证，以及本文的工作总结。首先我们来看一下本文的研究背景及选题意义。1、三网融合，不再是什么新鲜概念，。 2、关键是面对网络的融合，如何保障用户对多媒体业务的交互性、个性化的需求？就必须在网络设备和网络生命周期的各个阶段有效地对多媒体业务的服务质量和体验质量的各项指标进行测量。3、借助相关的测试设备，是保证服务质量一种重要手段，与传统的码流测试仪相比，手持式、低成本、多制式功能的需求逐步成为一种趋势，国内综合型的码流测试仪还很少，基于以上背景，本文提出了一种码流综合测试仪设计方案，能很好的完成网络和设备的故障监测。下面看看第二个方面的内容：视频码流服务质量监测标准。为了提供给用户前所未有的传播主体性和双向互动性，获得服务质量上的优势，不管是广电视频业务还是电信视频业务，都在大力采用流媒体技术开展宽带增值业务，但是两者的系统架构大体很相似。通过流媒体系统架构，我们可以将影响到媒体服务质量的因素划分