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- 2023-03-14 发布于四川
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本实用新型公开了一种异构多核处理器的时钟模块和异构多核处理系统,包括多个第一IP时钟域,第二IP时钟域;其中,第一IP时钟域和第二IP时钟域均包括锁相环单元、第一分频器、第一时钟门控单元和第一时钟切换单元,第一分频器和第一时钟门控单元串联连接后的第一端与锁相环单元的连接,第一分频器和第一时钟门控单元串联后的第二端与第一时钟切换单元连接,第一时钟切换单元用于输出相应的时钟信号或者通过至少一个第二分频器输出相应的时钟信号。第一IP时钟域和第二IP时钟域提供相应的时钟信号,满足高速IP和低速IP的时钟
(19)中华人民共和国国家知识产权局
(12)实用新型专利
(10)授权公告号 CN 213582080 U
(45)授权公告日 2021.06.29
(21)申请号 202021835688.2
(22)申请日 2020.08.28
(73)专利权人 珠海欧比特宇航科技股份有限公
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