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本发明公开的一种多处理器外设复用电路及其复用方法,能够避免多处理器同时访问同一外设冲突。本发明通过下述技术方案实现:在可编程逻辑单元PLU中,每个PUPLUIF总线读写器都设有共享外设锁定控制寄存器、共享外设锁定状态寄存器和外设控制及状态寄存器组。共享外设锁定控制寄存器、共享外设锁定状态寄存器连接共享外设锁定判决器,外设控制及状态寄存器组连接相连多路复用选择器,多路复用选择器串联执行器与外设相连;PUPLUIF总线读写器x接收到PUx的访问信号后,将数据写入共享外设锁定控制寄存器x或者外设控制及
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114036091 A
(43)申请公布日 2022.02.11
(21)申请号 202111278153.9
(22)申请日 2021.10.30
(71)申请人 西南电子技术研究所(中国电子科
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