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本发明公开了一种基于FPGA的芯片仿真加速方法和系统,包括主机利用预设的综合工具将用户设计的逻辑电路综合为RTL级表示文件;通过编写处理逻辑,将RTL级表示文件映射为带有特定功能的调试和控制用途的模块,并存储为预设格式的表示文件;获取用来辅助调试的电路模块,结合工具链将预设格式的表示文件生成位流,并下载到仿真加速器的FPGA系统中;在主机中加载加速器控制程序,主机的加速器控制程序通过物理通信方式和仿真加速器交换信号完成对用户设计逻辑的加速仿真。可对任意的用户RTL设计进行仿真,对运行在FPGA中
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116090372 A
(43)申请公布日 2023.05.09
(21)申请号 202310292028.6
(22)申请日 2023.03.23
(71)申请人 湖南泛联新安信息科技有限公司
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