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本发明的基于单向脉动阵列的堆栈式自编码算法推理的硬件实现，包括信号控制模块、输入输出控制模块、数据地址产生模块和计算阵列模块；信号控制模块：接收开始信号，控制各模块间通信，产生结束信号；输入输出控制模块：输入时读取片外DDR的数据并按特定方式存入片内SRAM，输出时将片内SRAM数据按特定方式写回DDR；数据地址产生模块：生成源数据或结果数据地址；计算阵列模块：以单向脉动阵列的方式进行神经网络算法的推理运算。本发明支持批处理，支持流水操作，通过乒乓操作实现部分计算时间和访存时间的隐藏，加速比高，
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 110232441 A
(43)申请公布日
2019.09.13
(21)申请号 20191
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