神经网络处理器中的三维卷积.pdfVIP

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2023-05-12 发布于四川
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神经网络处理器中的三维卷积.pdf

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本公开的实施方案涉及一种神经处理器电路的神经引擎，该神经处理器电路具有多个相乘相加电路以及耦接到这些相乘相加电路的累加器电路。这些相乘相加电路使用内核对输入数据的工作单元执行三维卷积的相乘相加运算，以在处理周期中生成输出数据的至少一部分。该累加器电路包括累加器的多个批次。累加器的每个批次在该处理周期之后接收并且存储针对多个输出深度平面中的每个输出深度平面的该输出数据的该部分。累加器的对应批次在该处理周期之后存储针对这些输出通道的子集以及针对每个输出深度平面的该输出数据的该部分。

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114600128 A (43)申请公布日 2022.06.07 (21)申请号 202080074320.5 (74)专利代理机构北京市汉坤律师事务所