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本申请公开了用于处理器非写回能力的装置、方法和系统。描述了关于处理器非写回能力的系统、方法和装置。在一个实施例中，处理器包括：多个逻辑处理器；控制寄存器，包括非写回锁禁用位；高速缓存，由多个逻辑处理器共享；总线，用于将高速缓存耦合至存储器以对来自多个逻辑处理器的对存储器的存储器请求进行服务；以及存储器控制器，用于：当非写回锁禁用位被设置为第一值时，禁用总线对由多个逻辑处理器中的逻辑处理器发布的读取‑修改‑写入类型的存储器请求的非写回锁访问，以及当非写回锁禁用位被设置为第二值时，实现总线对读取‑修
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112579158 A
(43)申请公布日
2021.03.30
(21)申请号 20201
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