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- 2023-06-05 发布于四川
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一种半导体器件包括内部时钟生成电路,其被配置成在第一模式和第二模式中从第一和第三分频时钟以及地电压生成第一至第四内部时钟。该半导体器件还包括数据处理电路,其被配置成根据第一至第四输入控制信号锁存第一至第四内部数据。该数据处理电路还被配置成通过根据第一至第四内部时钟、第一至第四上升输出控制信号以及第一至第四下降输出控制信号确定锁存的第一和第三内部数据和锁存的第二和第四内部数据的输出优先级来生成第一至第四输出数据。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112750483 A
(43)申请公布日 2021.05.04
(21)申请号 202010274606.X
(22)申请日 2020.04.09
(30)优先权数据
10-2019-0
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