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本发明公开了一种PCB布局布线中关于DDR4接口的设计方法。本设计拓扑结构仍为FLY‑BY，对每组信号内的同一信号，将走线位置不同的分段进行阻抗同一，不再进行分段控制阻抗。通过对原有PCB走线方式进行改进，设计新的阻抗控制，通过简化走线方式，在满足信号完成性的前提下，来解决PCB上的DDR4接口设计难度大的问题。与现有设计方法相比，可以不用进行复杂的区域约束，DDR4接口的所有内层单端线使用一个线宽即可；所有内层差分线使用一个线宽/线间距即可。可以节省一半以上的设计时间，阻抗控制简洁明确，提高了
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112739013 A
(43)申请公布日 2021.04.30
(21)申请号 202011386765.5
(22)申请日 2020.12.02
(71)申请人 天津光电通信技术有限公司
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