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- 2023-06-06 发布于四川
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本发明提供了一种用于serdes接口的桥接模块，包括写入控制、读出控制和Be_fifo子模块；所述写入控制包括级联的通道控制子模块、第一选择器、补偿频差删除子模块和第二选择器；所述读出控制包括通道读控制子模块、第三选择器、第四选择器、补偿频差补位子模块、第五选择器和第六选择器。本发明的用于serdes接口的桥接模块，降低了数据的处理时延，提升整个serdes端口传输性能。
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 112765066 B
(45)授权公告日 2022.07.08
(21)申请号 202011491396.6 G06F 13/42 (2006.01)
(22)申请日 2020.12
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