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- 2023-06-06 发布于四川
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本发明公开一种基于BSC单元特性的系统级边界扫描链的集成设计方法,属于集成电路可测性设计领域。在IP核的外部I/O端口下插入BSC单元,形成IP核局部边界扫描链;在SoC核心逻辑生成边界扫描链和JTAG控制器;然后在系统级,根据BSC单元的特性将IP核局部边界扫描链连接到SoC核心逻辑边界扫描链上,形成一个完整的系统级边界扫描链。在大规模集成电路可测性设计时,运用本发明的方法,能有效避免冗余测试逻辑的产生,同时减少对I/O端口的消耗,在系统级实现了简单高效的边界扫描测试,大大地降低了设计的复杂度
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112763898 A
(43)申请公布日 2021.05.07
(21)申请号 202011527393.3
(22)申请日 2020.12.22
(71)申请人 中国电子科技集团公司第五十八研
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