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- 2023-07-05 发布于四川
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本公开提供了用于数据选通写入定时的设备、系统和方法。存储器装置可在写操作期间接收数据选通时钟信号和串行写数据。所述存储器的解串行器电路可使用基于所述数据选通时钟信号的定时将所述串行写数据转换为并行写数据。例如，一或多个内部信号可基于所述数据选通时钟信号而生成并用于激活所述解串行器电路的各种操作。所述数据选通时钟信号还可用于激活所述存储器装置的位线，以便沿着那些激活的位线将所述并行写数据写入存储器单元。所述存储器还可接收与所述数据选通时钟信号分离的系统时钟，所述系统时钟可用于所述存储器的其它操作。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113808631 A
(43)申请公布日 2021.12.17
(21)申请号 202110641221.7
(22)申请日 2021.06.09
(30)优先权数据
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