用于集成电路时序设计中的自动修正系统及方法.pdfVIP

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2023-07-07 发布于四川
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本发明涉及半导体芯片技术领域，具体涉及一种用于集成电路时序设计中的自动修正系统及方法，本发明将数据模块中的违约端口全称和裕量分类到端口最大负载违约模块和端口信号转换时间违约模块，将端口信号转换时间违约端口违约信息送入datapath端口信号转换时间违约模块或clockpath端口信号转换时间违约模块，遍历修正模块分别遍历端口违约模块并转换违约信息，违约信息经过增加驱动模块和插入缓冲器模块的修正，输出到修正结果模块。本发明可以快速修复最大负载以及端口信号转换时间违约，并提供详细数据、物理位置等

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113850041 A (43)申请公布日 2021.12.28 (21)申请号 202111200179.1 (22)申请日 2021.10.14 (71)申请人上海亿家芯集成电路设计有限公司