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本发明涉及电路监测的技术领域,公开了一种集成电路逻辑失效监测电路及隔离电路;本发明将第一逻辑电平单元与第一组合逻辑电路电连接,第一逻辑电平单元将根据第一组合逻辑电路的工作电压状态输出第一逻辑电平或第二逻辑电平,与门单元会根据接收到的逻辑电平而输出监测信号,当第一组合逻辑电路的工作电压失效时,第一逻辑电平单元输出第二逻辑电平,此时与门单元输出第二监测信号,即可检测到第一组合逻辑电路的工作电压失效,与传统的方法相比,本发明无需设置一个高于实际失效电压的预设值,不会在逻辑电路未失效时就判断逻辑电路的工
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116436446 A
(43)申请公布日 2023.07.14
(21)申请号 202310688193.3
(22)申请日 2023.06.12
(71)申请人 深圳市赛元微电子股份有限公司
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