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2023年长沙理工大学网络工程专业《计算机组成原理》科目期末试卷A（有答案） 一、选择题 1、主存按字节编址，地址从0A4000H到0CBFFFH，共有（ ）字节；若用存储容量为32K×8位的存储芯片构成该主存，至少需要（ ）片。 A.80K，2 B.96K，2 C.160K，5 C.192K，5 2、采用指令Cache与数据Cache分离的主要目的是（ ）。 A.降低Cache的缺失损失 B.提高Cache的命中率 C.降低CPU平均访存时间 D.减少指令流水线资源冲突 3、假定编译器对高级语言的某条语句可以编译生成两种不同的指令序列，A、B和C三类指令的CPl和执行两种不同序列所含的三类指令条数见下表。则以下结论错误的是（）。 I.序列一比序列二少l条指令 Ⅱ.序列一比序列二的执行速度快 Ⅲ.序列一的总时钟周期数比序列二多1个 Ⅳ.序列一的CPI比序列二的CPI大 A.I、ll B.1、Ⅲ C. ll、1V D.Ⅱ 4、下列关于配备32位微处理器的计算机的说法中，正确的是（ ）。 该机器的通用寄存器一般为32位 Ⅱ.该机器的地址总线宽度为32位 Ⅲ.该机器能支持64位操作系统 IV.一般来说，64位微处理器的性能比32位微处理器的高 A.I、Ⅱ B.I、Ⅲ C.I、Ⅳ D.I、IⅡ、Ⅳ 5、下列选项中，能缩短程序执行时间的措施是（ ）。 1.提高CPU时钟频率Ⅱ.优化数据通路结构ll.对程序进行编译优化 A.仪I、Ⅱ B.仅I、Ⅲ C.仅Ⅱ、I D.I、Ⅱ、Ⅲ 6、某总线共有88根信号线，其中数据总线为32根，地址总线为20根，控制总线36根，总线工作频率为66MHz、则总线宽度为（ ），传输速率为（ ） A.32bit 264MB/s B.20bit 254MB/s C.20bit 264MB/s D.32bit 254MB/s 7、某同步总线的时钟频率为100MHz，宽度为32位，地址/数据线复用，每传输一个地址或数据占用一个时钟周期。若该总线支持突发（猝发）传输方式，则一次“主存写”总线事务传输128位数据所需要的时间至少是（ ）。 A.20ns B.40ns C.50ns D.80ns 8、下列部件中不属于控制部件的是（ ）。 A.指令寄存器 B.操作控制器 C.程序计数器 D.状态条件寄存器 9、从一条指令的启动到下一条指令启动的时间间隔称为（ ） A.时钟周期 B.机器周期 C.节拍 D.指令周期 10、I/O指令实现的数据传送通常发生在（ ）。 A.I/O设备和I/O端口之间 B.通用寄存器和I/O设备之间 C.I/O端口和I/O端口之间 D.通用寄存器和I/O端口之间 11、某磁盘的转速为10 000r/min，平均寻道时间是6ms，磁盘传输速率是20MB/s，磁盘控制器延迟为0.2ms，读取一个4KB的扇区所需平均时间约为（ ）。 A.9ms B.9.4ms C.12ms D.12.4ms 12、并行加法器中，每位全和的形成除与本位相加两数数值位有关外，还与（ ）有 A.低位数值大小 B.低位数的全和 C.高位数值大小 D.低位数送来的进位 13、当定点运算发生溢出时，应（ ）。 A.向左规格化 B.向右规格化 C.舍入处理 D.发出出错信息 14、假定编译器对C源程序中的变量和MIPS中寄存器进行了以下对应：变量f、g、h、i、i分别对应给寄存器$s0，$s1，$s2，$s3，$s4，并将一条C赋值语句编译后生成如下汇编代码序列： add $s0,$s1,$s2， add $t1,$s3,$s4 sub $s0,$t0,$t1 请问这条C赋值语句是（ ）。 A. f=（g+i）-（h+i） B. f=（g+j）-（h+i） C. f=（g+ h）-（j +i） D. f=（j +i）-（g+ h） 15、寄存器间接寻址方式中，操作数在（ ）中。 A.通用寄存器 B.堆栈 C.主存单元 D.指令本身 二、填空题 16、寻址方式按操作数的物理位置不同，多使用_______型和_______型，前者比后者执行速度快。 17、为了运算器的高速性，采用了________进位，________乘除法，________等并行技术措施。 18、汉字的________、________、________是计算机用于汉字输入、内部处理、输出三