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- 2023-08-30 发布于四川
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本发明提出一种基于块的电路延时模型的建立方法,提高先进工艺近阈值工作电压条件下,电路时序行为描述的准确性,以及大规模电路时序行为分析的速度。首先,采用基于块的统计静态时序分析方法,计算单输入单输出、双输入单输出、多输入单输出的延时特征,均值和方差,并通过仿真建立增量Δ模型,提高延时精度。其次,将组合逻辑电路网表转化成有向无环图,计算延时概率,标注有向无环图每条边的权值,采用平均‑最大联合标签最短路径算法,获得电路关键路径,结合Yens偏离算法获得关键路径集合。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114239444 A
(43)申请公布日 2022.03.25
(21)申请号 202111570389.X
(22)申请日 2021.12.21
(71)申请人 东南大学
地址 21
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