描述了一个数字调制器的设计流程,包括MPSK调制解调器的具体功能、实现方式和典型应用场景。1.MPSK调制解调器的工作原理:利用数字电路和专用芯片对基带信号进行码元变换,成形滤波等处理后得到同相分量和正交分量,然后将两路信号分量经过数模转换获得模拟信号送入一个正交相乘器与中频载波调制得到中频MPSK调制信号。2.系统功能:该调制器可以用于各种需要高效信号处理和传输的场合,例如:卫星通信、数据通信、远程监控、自动驾驶等。3.实例应用:MPSK调制解调器已经在多种现代通信系统中
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硬件描述语言及 EDA 设计
项目名称:基于 FPGA 的调制器的设计
专 业 : 设 计 人: 学 号 : 指导教师: 得 分 :
电子与通信工程田 文 正2013704045
全海燕
基于 FPGA 的调制器的设计
绪论
作为数字通信技术中重要组成部分的调制解调技术一直是通信领域的热点 课题。随着当代通信的飞速发展,通信体制的变化也日新月异,新的数字调制方式不断涌现并且得到实际应用。目前的模拟调制方式有很多种,主要有AM、FM、SSB、DSB、CW 等,而数字调制方式的种类更加繁多,如 ASK、FSK、MSK、GMSK、PSK、DPSK、 QPSK、QAM 等。在众多调制方式中,MPSK 信号由于抗干扰能力强而得到了广泛的应用,具有较高的频谱利用率和较好的误码性能,并且实现复杂度小,解调理论成熟,广泛应用于数字微波、卫星数字通信系统、有线电视的上行传输、宽带接入与移动通信等领域中,并已成为新一代无线接入网物理层和B3G 通信中使用的基本调制方式。现场可编程门阵列 (Field Programmable Gate Array,FPGA)是 20 世纪 90 年代发展起来的大规模可编程逻辑器件,随着电子设计自动化(ElectronDesign Automation EDA)技术和微电子技术的进步,FPGA 的时钟延迟可达到 ns 级,结合其并行工作方式,在超高速、实时
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