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本申请公开了一种基于卷积神经网络硬件加速器的FPGA多通道设计系统及装置。通过应用本申请设计的利用双通道验证环境的FPGA设计系统，可以自动在第一个通道配置结束后的数据计算阶段内切换通道配置，数据处理与寄存器配置并行操作FPGA验证请求。具体为一方面可以根据系统中用于表征其当前处理能力的组件启动数量来选择对各个验证请求的处理方式。另一方面也实现了卷积神经网络的仿真在硬件上的实现，进而能够对芯片进行软硬件的协同验证，增加了验证的覆盖率。本申请通过乒乓形式的寄存器配置实现了数据传输与寄存器配置并行运
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 116976404 A
(43)申请公布日 2023.10.31
(21)申请号 202310777073.0
(22)申请日 2023.06.28
(71)申请人 杭州未名信科科技有限公司
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