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本发明涉及LLC谐振电路分析技术领域，具体涉及一种考虑半导体结电容大小的LLC十一模态时域分析方法；本方案在设计适应谐振电容电压电流值等约束条件的谐振参数的基础上，考虑了杂散电容等非理想因素，分析了死区时间内谐振，即一个开关周期内并包括了死区时间，将整个过程分为十一个模态进行分析；本方案在LLC变换器中，充分考虑了寄生电容对电路正常运行的不良影响，同时对不同模态下的电路模型进行了对比分析，对实际电路的设计有更大的参考价值，方法更加清晰简单，适用于实际工程。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 117009918 A
(43)申请公布日 2023.11.07
(21)申请号 202310794041.1
(22)申请日 2023.06.30
(71)申请人 北京交通大学
地址 100044
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