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本发明提供的一种对PCB提取拓扑网络链路布局优化方法及系统,所述布局优化方法包括:建立网络拓扑图;采用最小生成树算法去除所述网络拓扑图中的环状结构,使链路呈现树形结构;计算链路的初始位置,使链路在垂直或水平方向上形成层次状结构;采用布局优化算法来解决出现的链路交叉现象,同时使整个链路布局紧凑且尽量对称。有助于提供准确的仿真模型、优化电路性能、保证信号完整性和提高故障排查效率。通过合理的链路布局,提高仿真结果的可靠性和可信度,为电路设计和优化提供有力支持。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117521592A
(43)申请公布日2024.02.06
(21)申请号202311459675.8
(22)申请日2023.11.03
(71)申请人芯和半导体科技(
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