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本发明公开一种支持硬件故障随机覆盖的锁步存内计算结构，其该存内计算结构包括：N个IO通道和一个锁步计算IO通道；第一选择器，输入端连接N个IO通道的输出；第二选择器，输出端连接锁步计算IO通道的系数缓存数据输入；随机数发生器RNG的输出连接至第一选择器及第二选择器；锁步计算IO通道及第一选择器的输出端连接至异或比较器XOR，异或比较器XOR输出安全告警信息。在原有的多路计算通道的基础上额外增加了一路或多路专用的锁步计算通道(IO‑LOCK)作为普通计算通道共用的影子(SHADOW)计算通道，并通
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117573441A
(43)申请公布日2024.02.20
(21)申请号202311229381.6
(22)申请日2023.09.21
(71)申请人上海砺群科技有限公司
地址20
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