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本发明公开了一种基于SVD的平均池化光学电路实现方法，根据池化核序列的SVD分解结果来确定池化计算模块的光学网格架构、MZI的数量，并根据输入图像数据的尺寸来确定延迟线的长度和数量；根据MZI传输函数的置0运算，来确定池化计算模块中U模块、∑模块和V模块的不同位置MZI的相位；通过确定的延迟线的数量和长度，使得串并转换输入模块输出的光信号并行地输入到池化计算模块的输入端口，同一时刻的并行输入构成一个完整的数据窗口；通过串并转换输出模块对池化计算模块的输出结果进行展平操作，使光信号并行输出。本发明
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117590583A
(43)申请公布日2024.02.23
(21)申请号202311564432.0
(22)申请日2023.11.21
(71)申请人南京邮电大学
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