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鲁棒且高效的多处理器-协处理器接口.pdfVIP

鲁棒且高效的多处理器-协处理器接口.pdf

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    本发明提供了一种鲁棒且高效的多处理器‑协处理器接口，具体地提供了用于在GPU中的流式多处理器和加速协处理器之间使用的高效且鲁棒的多处理器‑协处理器接口的系统和方法。根据示例性实现，为了使用协处理器执行特定操作的加速，所述多处理器：发出一系列写入指令以将用于操作的输入数据写入协处理器可访问的存储位置，发出操作指令以使协处理器执行特定操作；然后发出一系列读取指令以从协处理器可访问的存储位置读取操作的结果数据到多处理器可访问的存储位置。

    (19)中华人民共和国国家知识产权局

    (12)发明专利申请

    (10)申请公布号CN110858387A

    (43)申请公布日

    2020.03.03

    (21)申请号20191

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