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本公开涉及使用分段存储器体系架构的模拟存储器内计算处理电路。存储器阵列包括具有以行列矩阵布置的存储器单元的子阵列，其中每行包括字线并且每个子阵列列包括局部位线。控制电路支持第一操作模式和第二操作模式，在第一操作模式中在存储器存取期间仅致动存储器阵列中的一条字线，在第二操作模式中在根据存储在存储器中的权重数据和施加的特征数据执行的存储器内计算期间同时致动每个子阵列的一条字线。将每个存储器单元耦合到子阵列的每一列的局部位线的计算电路系统将用于存储器内计算的特征数据的位与权重数据的位逻辑组合以在与全局
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117809716A
(43)申请公布日2024.04.02
(21)申请号202311271473.0G11C16/24(2006.01)
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