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本发明公开一种基于混合优化的芯片元件全局布局方法，使用扰动来辅助逃离局部最优；首先对芯片版面进行初始化，在每次迭代中，使用DREAMPlace进行全局布局直到收敛；使用三种扰动方法将扰动添加到当前布局结果中；完成N次迭代后，返回具有最优HPWL值的最佳解。本发明能够缓解目前流行的全局布局器容易陷入局部最优的特点，通过结合高效的扰动策略使其逃离局部最优，获得更好的全局布局结果。本方法相较于现有全局布局方法，优化效率高，性能表现好，且易于实现，可以被方便地应用到各种全局布局器中，有较大的实际应用潜力
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117852483A
(43)申请公布日2024.04.09
(21)申请号202410060109.8
(22)申请日2024.01.16
(71)申请人南京大学
地址210023
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