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数字电路实验练习题
1、用与非门组成异或门电路，用四 -2输入与非门74LS00实现，画出电路图，并连接电路实现。
2、设计一个半加器电路，输入为被加数A，加数B，输出为和数S，进位C。写出设计过程，画出电路图，用四-2输入与非门74LS00实现。
3、设计一个半加器电路，输入为被加数A，加数B，输出为和数S，进位C。写出设计过程，画出电路图，用双4选1数据选择器74LS153和74LS00实现。
4、设计一个全加器电路，输入为被加数A，加数B，低位的进位CI，输出为和数S，进位C。写出设计过程，画出电路图，用74LS138和74LS20实现。
5、设计一个全减器电路，输入为被减数A，减数B，低位的借位CI，输出为差D，借位J。写出设计过程，画出电路图，用74LS138和74LS20实现。
6、设计一个多数表决电路，输入为A、B、C，输出为Y。写出设计过程，画出电路图，用74LS138和74LS20实现。
7、设计一个三个开关控制一盏灯的电路，三个开关有一个或三个闭合时灯亮。写出设计过程，画出电路图，用74LS138和74LS20实现。
8、设计一个全加器电路，输入为被加数A，加数B，低位的进位CI，输出为和数S，
进位C。写出设计过程，画出电路图，用双4选1数据选择器74LS153和74LS00实现。9、设计一个全减器电路，输入为被减数A，减数B，低位的借位CI，输出为差D，
借位J。写出设计过程，画出电路图，用双4选1数据选择器74LS153和74LS00实现。
10、设计一个多数表决电路，输入为A、B、C，输出为Y。写出设计过程，画出电路图，用双4选1数据选择器74LS153和74LS00实现。
11、设计一个三个开关控制一盏灯的电路，三个开关有一个或三个闭合时灯亮。写出设计过程，画出电路图，74LS153和74LS00实现。
12、设计一个全加器电路，输入为被加数A，加数B，低位的进位CI，输出为和数S，进位C。写出设计过程，画出电路图，用两片8选1数据选择器74LS151实现。
13、设计一个多数表决电路，输入为A、B、C，输出为Y。写出设计过程，画出电路图，用8选1数据选择器74LS151实现。
14、设计一个全减器电路，输入为被减数A，减数B，低位的借位CI，输出为差D，
借位J。写出设计过程，画出电路图，用两片8选1数据选择器74LS151实现。
15、设计一个三个开关控制一盏灯的电路，三个开关有一个或三个闭合时灯亮。写出设计过程，画出电路图，用74LS151实现。
16、将JK触发器分别转换成D触发器、T触发器，写出设计过程，画出电路图并实现。
17、将D触发器分别转换成JK触发器、T′触发器，写出设计过程，画出电路图并实现。
18、用74LS192和适当的门电路（74LS00或74LS51）组成可控进制的加法计数器。M=0时执行4进制加法计数，M=1时执行8进制加法计数。
19、用74LS192和适当的门电路（74LS00、74LS20或74LS51）组成可控进制的加法计数器。M=0时执行5进制加法计数，M=1时执行8进制加法计数。
20、用74LS192和适当的门电路（74LS00、74LS20或74LS51）组成可控进制的加法计数器。M=0时执行4进制加法计数，M=1时执行7进制加法计数。
21、用74LS192和适当的门电路（74LS00、74LS20或74LS51）组成可控进制的加法计数器。M=0时执行6进制加法计数，M=1时执行9进制加法计数。
22、用两片74LS192和74LS00组成60进制加法计数器。
23、用两片74LS192和74LS00组成24进制加法计数器。
24、用两片74LS192和74LS00组成12进制加法计数器。
25、设计一个四进制加法计数器，写出设计过程，画出电路图，用JK触发器74LS76和适当的门电路实现。
25、设计一个四进制加法计数器，写出设计过程，画出电路图，用D触发器74LS74和适当的门电路实现。
26、用555定时器接成单稳态触发器，画出电路图，并测量出R、C，计算t .
W
27、用555定时器接成多谐振荡器，画出电路图，并测量出R、C，计算t、t 和
W1 W2
频率f.
28、设计一个多数表决电路，输入为A、B、C，输出为Y。写出设计过程，画出电路图，用74LS00和74LS20实现
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