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2024-05-25 发布于四川
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一种高速SAR结构ADC的比较器校正方法.pdf

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本发明公开了一种高速SAR结构ADC的比较器校正方法，涉及模拟或数模混合集成电路技术领域，包括以下步骤：S1、SARADC环路：去掉了比较器输出结构和开关及权重电容单元之间的逐次逼近逻辑，采用一个预放大级，完成一次逐次逼近过程，S2、选择逻辑输出：预放大级的输出信号输入到其对应的第i锁存器(i＝1,2,...,n)当中，并通过第i锁存器(i＝1,2,...,n)的输出信号Vi(i＝1,2,...,n)直接控制开关电容阵列中的相应的开关电容，直至完成一次逐次逼近过程。本发明通过高速SARADC

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN118074716A

(43)申请公布日2024.05.24

(21)申请号202410192303.1

(22)申请日2024.02.21

(71)申请人成都纳川微电子科技有限公司

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