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本发明提供了一种多核锁步处理器多级快速错误恢复系统，该系统由锁步处理器组、流水线寄存器检错与PC控制模块、处理器组检错与回卷模块、多级容忍控制模块组成。系统通过多级容忍控制模块对系统进行不同粒度的容错控制及错误管理，多级容忍控制模块调度全局的容错机制，一旦在某一级容错模块中的出错频率超过了所能容忍的限度，就暂停该模块的检错。模块停止检错使得错误向下一级传递，由下一级模块进行检错及恢复任务，其中最高一级的处理机制为对片外上报错误指示。本发明通过多级检错及错误恢复的方式达到在系统出现错误的时能够实现
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN118093253A
(43)申请公布日2024.05.28
(21)申请号202410521490.3
(22)申请日2024.04.28
(71)申请人西北工业大学
地址710072
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