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试验五计数器的设计——试验报告

邱兆丰一、试验目的和要求

1．生疏JK触发器的规律功能。

2．把握用JK触发器设计同步计数器。

二、试验仪器及器件

1、试验箱、万用表、示波器、

2、74LS73，74LS00，74LS08，74LS20

三、试验原理

1．计数器的工作原理

递增计数器----每来一个CP，触发器的组成状态按二进制代码规律增加。

递减计数器-----按二进制代码规律削减。

双向计数器-----可增可减，由掌握端来打算。

2．集成J-K触发器74LS73

⑴符号：

图1J-K触发器符号

⑵功能：

表1J-K触发器功能表

功能

功能

0000

保持

0011

0100

清零

0110

1001

置位

1011

1101

翻转

1110

↓

↓

↓

↓

↓

↓

↓

↓

CP

K

J

⑶状态转换图：

图2J-K触发器状态转换图

⑷特性方程：

⑸留意事项：

①在J-K触发器中，但凡要求接“1”的，肯定要接高电平〔例如5V〕，否则会消灭错误

的翻转。

①触发器的两个输出负载不能过分悬殊，否则会消灭误翻。

②J-K触发器的清零输入端在工作时肯定要接高电平或连接到试验箱的清零端子。

3．时序电路的设计步骤

内容见试验预习。

四、试验内容

1．用JK触发器设计一个16进制异步计数器，用规律观看CP和各输出波形。

2．用JK触发器设计一个16进制同步计数器，用规律观看CP和各输出波形。

3．设计一个仿74LS194

4．用J-K触发器和门电路设计一个特别的12进制计数器，其十进制的状态转换图为：

5.考虑增加一个掌握变量D，当D=0时，计数器按自定义内容运行，当D=1时，反方向运

行

五、试验设计及数据与处理

试验一

16进制异步计数器

设计原理：除最低级外，每一级触发器用上一级触发器的输出作时钟输入，JK都接

HIGH，使得低一级的触发器从1变0时高一级触发器恰好接收下降沿信号实现输出翻转。

试验二

16进制同步计数器

设计原理：除最低级外，每一级的JK输入都为全部低级的输出的“与”运算结果

试验三

仿74LS194

设计原理：前两个开关作选择端输入，下面四个开关仿照预置数输入，再下面两个开关仿照左移、右移的输入，最终一个开关仿照清零输入。四个触发器用同一时钟输入作CLK输入。用2个非门与三个与门做成了一个简洁译码器。对于每一个触发器，JK输入总为一对相反值，即总是让输入值作为输出值输入。对于每一个输入，当模式“重置”输出为1时，其与预置值结果即触发器输入；当模式“右移”、“左移”输出为1时，其值为上

一位或下一位对应值；当各模式输出均为0时各触发器输入为0，使输出为0。

试验四

设计原理：

在12进制同步计数器中，输出的状态只由前一周期的状态打算，而与外来输入无关，因此

目标电路为Moore型。而数字电路只有0和1两种状态，因此目标电路要表达12种状态需

要用4个变量Q1、Q2、Q3、Q4的16种组合中的12种。现定义十进制数01~12的对应二

进制数为输出状态，可得目标电路的状态转换表如下：

表212进制同步计数器状态状态转换表

CLK

1

2

3

4

5

6

7

8

9

0

0

0

0

0

0

0

1

1

0

0

0

1

1

1

1

0

0

0

1

1

0

0

1