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基于FPGA的DCM研究
摘要
信息时代的高速发展带动了现场可编程逻辑（FPGA）的快速发展。可编程逻辑器件的逻辑门数越来越多，器件面积减小，芯片的密度快速增大。高速度、高密度、低功耗、低电压的发展对器件时钟信号的频率要求越来越高，可编程逻辑器件中的时钟管理模块的设计也变得越来越重要。
本文重点研究Virtex-5系列中xc5vsx95t产品的数字时钟管理模块（DCM），对DCM系统组成进行详细分析，提出设计思路，并进行电路设计和仿真。该数字时钟管理模块可以实现三个功能：时钟去歪斜，频率合成，相位调整。数字时钟管理电路主要由延迟锁相环（DL
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