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实验4组合逻辑电路设计--第1页

数字逻辑与电路实验

学号：123012010080姓名：黄武松Email：1053756676@2年月日

实验四组合逻辑电路研究（设计性实验）

一、实验目的

1．掌握用SSI器件实现组合逻辑电路的方法。

2．熟悉各种MSI组合逻辑器件的工作原理和引脚功能。

3．掌握用MSI组合逻辑器件实现组合逻辑电路的方法。

4．进一步熟悉测试环境的构建和组合逻辑电路的测试方法。

二、实验所用仪器设备

1．Multisim10中的虚拟仪器

2．QuartusII中的功能仿真工具

3．GW48-EDA实验开发系统

三、实验说明

1.组合逻辑电路的设计一般可按以下步骤进行

（1）逻辑抽象：将文字描述的逻辑命题转换成真值表。

（2）选择器件类型：根据命题的要求和器件的功能决定采用哪种器件。

（3）根据真值表和所选用的逻辑器件写出相应的逻辑表达式：当采用SSI

集成门电路设计时，为了使电路最简，应将逻辑表达式化简，并变换成与

门电路相对应的最简式；当采用MSI组合逻辑器件设计时，则不用化简，

只需将由最小项构成的函数式变换成MSI器件所需要的函数形式。

（4）根据化简或变换后的逻辑表达式及选用的逻辑器件画出逻辑电路图。

2.常见的SSI和MSI的型号

（1）常见的SSI：四2输入异或门74LS86，四2输入与非门74LS00，六

非门74LS04，二4输入与非门74LS20，四2输入或非门74LS02，四2

输入与门74LS08等。

（2）常见的MSI：二2-4译码器74LS139，3-8译码74LS138，4-16译码

器74LS154，8-3线优先编码器74LS148，七段字符译码器74LS248，四

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数字逻辑与电路实验

学号：123012010080姓名：黄武松Email：1053756676@2年月日

位全加器74LS283，四2选1数据选择器74LS157，双4选1数据选择器

74LS153，8选1数据选择器74LS151，16选1数据选择器74LS150等。

四、实验内容

（一）基本命题

1．设计一个多输出的逻辑网络，它的输入是8421BCD码，它的输出定义为：

（1）F：检测到输入数字能被3整除。

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（2）F：检测到输入数字大于或等于4。

2

（3）F：检测到输入数字小于7。

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自选逻辑器件，列出设计步骤，画出逻辑电路图，记录测试结果。

解：

（1）逻辑器件：二-十进制译码器74HC52三输入端与非门7410

八输入端与非门7430指示灯

（2）由已知的命题得到以下的真值表表1

输入