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1.设计思路
1.1设计指标的确定
根据课程设计的指标要求，这里选择指标二作为设计目标，如表1.1。
性能参数设计指标
负载电容CL＝30pF
开环增益(低频)75dB
CMRR(低频)80dB
PSRR±(低频)80dB
共模输入范围1.2V
输出摆幅（峰峰值）1.6V(Conly)
L
电源电压2.5V,0
直流功耗15mW
单位增益带宽1MHz
压摆率2V/uS
建立时间（单位增益反馈配置、
输入阶跃函数（0→+1V,0→－1V）2uS
稳定值的±0.1%之内）
输出信号差分输出
ooo
恒温电流源150ppm/C(0~80)
表1.1运算放大器设计指标
1.2电路结构的确定
1.2.1放大电路方案选择
这里先对表1.1要求的性能参数作一简要分析。运算放大器的开环增益应大于75dB，
即5623，该值大约为2
(gr)量级。为了实现该增益值，输入信号至少需要经过2个放大管。
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有如下几种方案可以满足上述要求：单级套筒式共源共栅放大器，单级折叠式共源共栅放大
器，两级级联共源放大器。
由于设计要求较高的共模抑制比和电源电压抑制比，考虑到全差分电路具有很好的噪声
抑制功能，它能抑制输出信号中的偶次谐波，同时能提供较高的CMRR和PSRR，故设计
采用全差分电路。全差分电路还有一个好处就是它能提供较高的输出电压摆幅。
指标中要求共模输入范围大于1.2V，该值约为电源电压的一半。对于套筒式共源共栅
放大器，这是很难做到的，因为输入共模电平的大幅度变化可能导致MOS管处于关断或线
性状态。而折叠式共源共栅电路则具有输入共模范围大的优点，故本设计采用折叠式共源共
栅电路。在实际运用中为了提高共模输入范围，可以运用将NMOS和PMOS并排同时作为
输入端的Rail-to-Rail技术，它能将共模输入范围扩大到0－VDD。本设计不采用该技术。
使用折叠式共源共栅电路的另一个好处在于它能提高输出电压摆幅。
对于单级折叠式共源共栅电路，它的输出阻抗很高（为gr2量级），驱动能力较弱。为
mo
了提高电路的驱动能力，本设计采用两级放大电路，即在单级折叠式共源共栅电路后面级联
一个共源放大电路。
1
由此，运算放大器的核心放大电路已经基本确定，
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