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组合逻辑电路单元测试题
一、选择填空（20分）
1．若在编码器中有50个编码对象，则要求输出二进制代码位数为（）位。
A.5B.6C.10D.50
2．一个16选1的数据选择器，其地址（选择控制）输入端有（）个。
A.1B.2C.4D.16
3．一个4选1的数据选择器，其输入端有（）个。
A.1B.2C.4D.8
4．八路数据分配器，其地址输入端有（）个。
A.1B.2C.3D.4
5．一个译码器若有100个译码输出端，则译码输入端有（）个。
A.5B.6C.7D.8
6．用4选1数据选择器实现函数YAAAA,应使()。
1010
A.D=D=0，D=D=1B.D=D=1，D=D=0
02130213
C.D=D=0，D=D=1D.D=D=0，D=D=0
01230123
7．74LS138是3线-8线译码器，译码为输出低电平有效，若输入为AAA=110时，输
210
出YYYYYYYY分别应为。
76543210-
8．用3线-8线译码器74LS138实现原码输出的8路数据分配器，应S=，，。
SS
123
9．以下电路中，加以适当辅助门电路，()适于实现单输出组合逻辑电路。
A.二进制译码器B.数据选择器C.数值比较器D.七段显示译码器
10．组合逻辑电路消除竞争冒险的方法有()。
A.修改逻辑设计B.在输出端接入滤波电容
C.后级加缓冲电路D.屏蔽输入信号的尖峰干扰
11．在二-十进制译码器中，伪码应做约束项处理()。
A.对B.错
12．编码器在任何时刻只能对一个输入信号进行编码()。
A.对B.错
13．优先编码器的输入信号是相互排斥的，不容许多个编码信号同时有效()。
A.对B.错
14．二进制译码器相当于是一个最小项发生器，便于实现组合逻辑电路()。
A.对B.错
15．数据选
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