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.实用文档.
在程序的执行过程中,Cache与主存的地址映射是由〔1〕完成的。
【答案】C
【解析】
cache是高速缓冲存储器,作为CPU与主存之间的高速缓冲,有存储容量小,本钱大,
速度快的特点,存放经常被CPU访问的内容。cache和主存之间的映射由硬件自动完成。
某四级指令流水线分别完成取指、取数、运算、保存结果四步操作。假设完成上述操作
的时间依次为8ns、9ns、4ns、8ns,那么该流水线的操作周期应至少为〔2〕ns。
(2)
【答案】C
【解析】
内存按字节编址。假设用存储容量为32Kx8bit的存储器芯片构成地址从A0000H到
DFFFFH的内存,那么至少需要〔3〕片芯片。
(3)
【答案】B
【解析】
存储区域空间为:DFFFF-A0000+1=40000H。
计算机系统的主存主要是由〔4〕构成的。
(4)
【答案】A
【解析】
DRAM动态随机存取存储器,最为常见的系统内存。为了保持数据,DRAM必须周期性刷
新。
计算机运行过程中,CPU需要与外设进行数据交换。采用〔5〕控制技术时,CPU与外
设可并行工作。
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B.中断方式和DMA方式
C.程序查询方式和DMA方式D.程序查询方式、中断方式和DMA方式
【答案】B
【解析】
程序查询方式是按顺序执行的方式,由CPU全程控制。因此不能实现外设与CPU的并行
工作。中断方式,在外设做好数据传送之前,CPU可做自己的事情。发出中断请求之后,CPU
响应才会控制其数据传输过程,因此能一定程度上实现CPU和外设的并行。而DMA方式由
DMAC控制器向CPU申请总线的控制权,在获得CPU的总线控制权之后,由DMAC代替CPU控
制数据传输过程。
李某购置了一张有注册商标的应用软件光盘,那么李某享有〔6〕。
【答案】B
【解析】
购置光盘,只拥有光盘的所有权。
某软件工程的活动图如以下列图所示,其中顶点表示工程里程碑,连接顶点的边表示包
含的活动,边上的数字表示活动的持续时间〔天〕。完成该工程的最少时间为〔7〕。由于某
种原因,现在需要同一个开发人员完成BC和BD,到完成该工程如最少时闻为〔8〕天。
(7)
(8)
【答案】BC
【解析】
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关键路径:最长的一段〔ABCEFJ==ABDGFJ=18天〕,BD、BF只能由同一个人来完成,因
此最快的方式为,先完成BD再去完成BC〔因此相当于此时,关键路径ABCEFJ上推迟了2
天完成,因此此时工程完成的最少时间为20天〕。
以下关于程序设计语言的表达中,错误的选项是〔9〕。
【答案】A
【解析】
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在基于Web的电子商务应用中,访问存储于数据库中的业务对象的常用方式之一是
〔10〕。
(10)
【答案】A
【解析】
数据库连接(JDBC)由一组用Java编程语言编写的类和接口组成,它提供了一个标准的
API。
以下列图所示的调制方式是〔11〕,假设数据速率为1kb/s,那么载波速率为〔12〕Hz。
(11)
(12)
【答案】AB
【解析】
根据图形可知是以载波的相对初始相位变化来实现数据的传送,并且初始相位与前一码
.
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