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数字电子技术基础复习题
数字电子技术基础复习题
复习题
一、填空题
1.(48)10=()２=()16=()8421BCD=()余三码
2.2015个1异或的结果为。
3.三态门的输出是1态、和。
4.一个8线-3线编码器，当输入0010000001234567=YYYYY
YYY时，输出代码是。
5.若将一个异或门（输入为A、B）当作反相器来使用，则输入
A、B端。
6.逻辑函数式)(CDABY+=，其反函数=Y。
7.555定时器可以组成、、。
8.用5级触发器组成20进制计数器，其无效状态个数为。
9.一个四位二进制减法计数器，其状态初始值为1010，经过100
个时钟周期以后，该计数器的状态值为。
10.如(110011)2为有符号数，则其反码为，补码为
11（1A）16=()２=()8=()10=()8424BCD12个201同或的
结果为。
13.三态门的输出可以并联使用，实现功能14.一个8线-3线优
先编码器，输入高电平有效，Y7最优先，当Y0Y1Y2Y3Y4Y5Y6Y
7时，输出代码是。15.四个逻辑变量共有个逻辑相邻项
165个触发器构成环形计数器，共有个有效状态。174个逻辑
变量；一共构成个最小项。
18.用5级触发器组成扭环形计数器，其无效状态个数为个。19.
一个四位二进制加法计数器，其状态初始值为1010，经过100个时钟
周期以后，该计数器的状态值为。
20.如(1100100)2为有符号数，则其反码为，补码为。二、判
断题
1．若两个函数具有不同的逻辑函数式，则两个逻辑函数必然不相
等。（）2．三态门的三种状态分别为：高电平、低电平、不高不低
的电压。（）
3.
时序逻辑电路的特点是：电路任一时刻的输出状态与同一时刻的
输入信号有关，与原有状态没有任何的联系（）4.编码与译码是互逆
的过程。（）
5.同步时序电路具有统一的时钟CLK控制。（）
6.时序逻辑电路在某一时刻的输出状态与该时刻之前的输入信号
无关。（）
7.D触发器的特性方程为Q*=D，与Q无关，所以它没有记忆功
能。（）
8.用数据选择器可实现时序逻辑电路。（）9.16位输入的二进制
编码器，其输出端有4位。（）10.时序电路不含有记忆功能的器件。
（）
三、分析设计题
1.用公式法化简式子DEABBCDACBACDBDCBDEY
)(+++++++=
2.利用3线-8线译码器74HC138和门电路产生如下函数。
BC
CABCABYCBACY++=+=21
3.若主从SR触发器的CLK、S、R的电压波形如图中所示，试画
出输出信号的波形，假定触发器的初始状态为Q=0。
4.利用时序逻辑电路分析方法分析下图所示时序逻辑电路的逻辑
功能，判断能否自启动。
5.分析右下图所示计数器电路，说明这是多少进制的计数器；两
片之间是多少进制；利用此方法实现75进制的计数器，画出对应的电
路图（，芯片已给出），其中计数器74160的功能表如下所示见左下
图所示。
、分析与设计
6、如图1，组合逻辑电路
（1）写出Y1、Y2的逻辑表达式（2）列出真值表（3）分析逻辑
功能
图1
7.用与非门设计一个3变量的多数表决电路，当输入变量A、B、
C有2个或2个以上为1时输出为1，输入为其它状态时输出为0。要
求：（1
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