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ApplicationReport
SPRA472
TMS320C6211CacheAnalysis
TheTMS320C6211’scachesdeliverhighperformancewithoutthecostoflargearraysof
on-chipmemory.TheefficiencyoftheTMS320C6211cachesmakeslowcost,high-
densityexternalmemory,suchasSDRAM,aseffectiveason-chipmemory.
Contents
1CacheArchitectureOverview2
1.1Level-oneProgramCache(L1P)3
1.2Level-oneDataCache(L1D)4
1.3Level-twoCache/UnifiedMemory(L2)4
2CachePerformance7
2.1Price/Performance7
2.2Two-LevelCacheBenefits7
2.2.1L2reduceslatencyduetocachemiss8
2.2.2UnifyingprogramanddatainL28
2.3Real-timeoperation8
2.3.1Predictability8
2.3.2InterruptLatency8
3EfficientI/OCapability9
3.1Easeofuse10
4Summary10
Figures
Figure1.TMS320C6211BlockDiagram2
Figure2.TMS320C6211Two-levelcachefetchflow3
Figure3.L2MemoryConfigurations,Diagram15
Figure4.L2MemoryConfigurations,Diagram25
Figure5.DataAllocationinMultipleCacheWays6
Figure6.Typicalprocessorperipheraldataflow9
Figure7.TMS320C6211peripheraldataflow9
Tables
Table1.TMS320C6211BenchmarkPerformance7
DigitalSignalProcessingSolutionsSeptember1998
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SPRA472
1Cache
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