Nvdia-RT图灵GPU架构介绍.pptxVIP

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2025-10-17 发布于北京
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NvdiaRTX图灵GPU架构介绍RTXON–THENVIDIATURINGGPU1

TuringSM14TFLOPS+14TIPSConcurrentFPINTEnhancedL1cacheUniformdatapathRFINTRODUCINGTURINGGreatestLeapSince2006CUDAGPURTCoreFirstRayTracingGPU10GigaRays/secRayTriangleIntersectionBVHTraversalTensorCore114TFLOPSFP16228TOPSINT8455TOPSINT42

TU102–TITANRTX18.6BILLIONTRANSISTORS3INTRODUCINGTURINGSM72CUDACORES4608TENSORCORES576RTCORES72GEOMETRYUNITS36TEXTUREUNITS288ROPUNITS96MEMORY384-bit7GHzGDDR6NVLINKCHANNELS2

TuringSM14TFLOPS+14TIPSConcurrentFPINTEnhancedL1cacheUniformdatapathRFNVIDIATURINGGPU–NEWEFFICIENTSMTuringSM1.5xPascalSMPerformanceRTCoreFirstRayTracingGPU10GigaRays/secRayTriangleIntersectionBVHTraversalTensorCore114TFLOPSFP16228TOPSINT8455TOPSINT44

TURINGSM5ConcurrentFPINTExecutionDatapathsEnhancedL1cacheUniformDatapathRF

BuiltonfoundationofVoltaSM(V100:HPC/DatacentersolutionbetweenPascalandTuringArchitectures:seeHotChips2017talk)ComparedtoPascal,Turingprovides:TwicetheschedulersSimplifiedissuelogicLarge,fastL1cacheunifiedwithTEX$andSharedMemoryTURINGSMMICROARCHITECTUREEvolvedforEfficiencySML1I$4warpinstr/clkSub-Core1warpinstr/clk64B/clkL1D$SharedMemory96kB64B/clkSub-Core1warpinstr/clk64B/clkSub-Core1warpinstr/clk64B/clkSub-Core1warpinstr/clk64B/clkMIOTEX1quad/clkL2$1warp=32threads6

NEWCACHESHAREDMEMARCHITECTUREComparedtoPascal:2xL1BandwidthLowerL1HitLatencyUpto2.7xL1Capacity2xL2CapacityCrossbarSMGlobalDataSharedMemory96kBMIOGlobalDataSharedSub-core SharedDataInstructionsDataL1D$24kBL2$3MBL1D$24kBCrossbarL2$6MBTEX1quad/clkMIOSchedulerTEX1quad/clkL1D$SharedMemory32kB+64kB64kB+32kBEvolvedforEfficiencyPASCAL TURINGMIOSchedulerMIOSub-coreInstructionsTextureDataGlobal/SharedDataGlobal/SharedDataMIOSchedulerTEX1quad/clkL1D$SharedMemory32kB+64kB64kB+32kBSub-core