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(2025年)数字电路设计考试题库及答案

一、选择题（每题2分，共20分）

1.二进制换为十六进制数是（）。

A.B6HB.96HC.C6HD.A6H

答案：A

2.逻辑函数F=AB+BC的最小项表达式为（）。

A.m3+m5+m6B.m2+m3+m6C.m1+m3+m7D.m3+m5+m7

答案：B（展开后F=AB(C+?C)+BC(A+?A)=ABC+AB?C+ABC+?ABC=AB?C+?ABC+ABC=m6+m2+m3）

3.三态门输出的三种状态不包括（）。

A.高电平B.低电平C.高阻态D.悬浮态

答案：D（三态门输出为高电平、低电平、高阻态，悬浮态非标准表述）

4.下列关于卡诺图化简的描述中，错误的是（）。

A.圈1得原函数，圈0得反函数

B.每个圈应包含尽可能多的相邻项（2?个）

C.无关项既可当1也可当0处理

D.化简后的表达式一定是最简与或式

答案：D（卡诺图化简可能得到不同形式的最简式，如与或式或或与式，需根据需求选择）

5.同步时序电路与异步时序电路的主要区别是（）。

A.有无触发器B.触发器是否共用同一时钟

C.输入信号数量D.输出是否与输入有关

答案：B（同步电路中所有触发器由同一时钟触发，异步电路时钟不同步）

6.欲用74LS161（4位同步二进制计数器，同步置数、异步清零）设计模13计数器，最简的置数法应设置预置数为（）。

A.3B.13C.12D.4

答案：A（模13需从0计数到12，共13个状态。当Q3Q2Q1Q0=1100（12）时，通过与非门反馈置数，预置数=13-12-1=0？错误。正确方法：同步置数时，当计数到N-1=12时置数，预置数=16-13=3，因此预置数为3）

7.下列触发器中，抗干扰能力最强的是（）。

A.基本RS触发器B.同步RS触发器

C.主从JK触发器D.边沿D触发器

答案：D（边沿触发器仅在时钟边沿敏感，抗干扰能力优于电平触发或主从触发）

8.RAM与ROM的主要区别是（）。

A.RAM可读可写，ROM仅可读

B.RAM速度快，ROM速度慢

C.RAM掉电后数据保留，ROM不保留

D.RAM用于存储程序，ROM用于存储数据

答案：A（ROM通常为只读（或仅可擦写有限次），RAM可读可写，掉电数据丢失）

9.用4位二进制计数器构成环形计数器，其有效状态数为（）。

A.4B.8C.16D.2

答案：A（环形计数器状态数等于触发器个数，4位则4个有效状态）

10.下列VHDL语句中，正确的进程（PROCESS）敏感列表写法是（）。

A.PROCESS(a,b)B.PROCESSa,b

C.PROCESS[a,b]D.PROCESS{a,b}

答案：A（敏感列表用括号括起，信号间用逗号分隔）

二、填空题（每空1分，共20分）

1.十进制数27转换为二进制是（），8421BCD码是（）。

答案：11011；00100111

2.逻辑函数F=?(A⊕B)的与非-与非表达式为（）。

答案：?(?(AB)·?(?A?B))（或简化为?(?AB·??A?B)，需用与非门实现）

3.组合逻辑电路的竞争冒险是由于（）引起的，消除方法包括（）（任写一种）。

答案：信号传输延迟；引入选通脉冲（或增加冗余项、输出端并联电容）

4.主从JK触发器在CP=1期间，若输入信号发生多次翻转，可能导致（）现象，因此实际应用中多采用（）触发器。

答案：一次翻转；边沿

5.74LS138是3线-8线译码器，其使能端有效时（G1=1，?G2A=?G2B=0），输出（）电平有效。若用其实现逻辑函数F=?ABC+A?BC+AB?C，需连接（）引脚到与非门输入端。

答案：低；?Y3、?Y5、?Y6（对应最小项m3、m5、m6，输出低有效，故取反后与非）

6.同步计数器中，各触发器的时钟信号（），异步计数器中（）。

答案：相同（或同步）；不同（或不同步）

7.555定时器构成多谐振荡器时，其振荡频率f=（）（用R1、R2、C表示）。

答案：1/[0.7(R1+2R2)C]（充电时间0.7(R1+R2)C，放电时间0.7R2C，总周期T=0.7(R1+2R2)C）

8.用1K×4位的RAM芯片扩展成4K×8位的存储器，需（）片芯片，其中（）扩展用于增加字数，（）