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4选1选通器verilog代码.docxVIP

4选1选通器verilog代码.docx

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    3实验3

    3.1实验内容

    题目：设计一个1位的四选一多路选择器

    要求：1.使用二选一多路选择器模块进行搭建

    2.出现正确的仿真波形，无需板子上验证。

    3.2实验步骤

    系统设计

    利用3个2选1选通器搭建4选1一位选通器。利用第二题中已编写好的2选1选通器，在新编写的4选1中实例化三个子模块实现。设计原理图如下：

    重要源代码及注释

    4选1：

    modulemux4to1(a,b,c,d,s1,s2,out);

    inputwirea,b,c,d;

    inputwires1,s2;

    outputwireout;

    wireout1,out2;

    mux2to1f1(.

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