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面向微控制器的卷积神经网络加速器设计.pdfVIP

面向微控制器的卷积神经网络加速器设计.pdf

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    第４７卷第１期电子器件Ｖｏｌ４７Ｎｏ１

    ２０２４年２月ＣｈｉｎｅｓｅＪｏｕｒｎａｌｏｆＥｌｅｃｔｒｏｎＤｅｖｉｃｅｓＦｅｂ.２０２４

    ＤｅｓｉｇｎｏｆＣｏｎｖｏｌｕｔｉｏｎａｌＮｅｕｒａｌＮｅｔｗｏｒｋＡｃｃｅｌｅｒａｔｏｒｆｏｒＭｉｃｒｏｃｏｎｔｒｏｌｌｅｒ∗

    ∗

    ＱＩＡＯＪｉａｎｈｕａꎬＷＵＹａｎꎬＬＩＹａｎｉｎｇꎬＬＥＩＧｕａｎｇｚｈｅｎｇ

    (ＳｃｈｏｏｌｏｆＥｌｅｃｔｒｏｎｉｃＩｎｆｏｒｍａｔｉｏｎＥｎｇｉｎｅｅｒｉｎｇꎬＴａｉｙｕａｎＵｎｉｖｅｒｓｉｔｙｏｆＳｃｉｅｎｃｅａｎｄＴｅｃｈｎｏｌｏｇｙꎬＴａｉｙｕａｎＳｈａｎｘｉ０３００２４ꎬＣｈｉｎａ)

    Ａｂｓｔｒａｃｔ:Ａｉｍｉｎｇａｔｔｈｅｐｒｏｂｌｅｍｔｈａｔｔｈｅｐｅｒｆｏｒｍａｎｃｅｏｆｅｍｂｅｄｄｅｄｍｉｃｒｏｃｏｎｔｒｏｌｌｅｒｉｓｄｉｆｆｉｃｕｌｔｔｏｍｅｅｔｔｈｅｔａｓｋｏｆｒｅａｌ￣ｔｉｍｅｉｍａｇｅｒｅｃｏｇ￣

    ｎｉｔｉｏｎꎬａｃｏｎｖｏｌｕｔｉｏｎａｌｎｅｕｒａｌｎｅｔｗｏｒｋａｃｃｅｌｅｒａｔｏｒｓｕｉｔａｂｌｅｆｏｒｍｉｃｒｏｃｏｎｔｒｏｌｌｅｒｉｓｐｒｏｐｏｓｅｄ.Ｔｈｅａｃｃｅｌｅｒａｔｏｒｈａｓａｎｏｎｂｌｏｃｋｉｎｇｒｏｗｐａｒａｌ￣

    ｌｅｌｍｕｌｔｉｐｌｉｅｒａｄｄｅｒｕｎｉｔｓｔｒｕｃｔｕｒｅｉｎｔｈｅｃｏｎｖｏｌｕｔｉｏｎａｌｌａｙｅｒ.Ｉｔｈａｓｈｉｇｈｅｒｈａｒｄｗａｒｅｕｔｉｌｉｚａｔｉｏｎ.Ｉｎｏｒｄｅｒｔｏｍｅｅｔｔｈｅｔｈｒｏｕｇｈｐｕｔｏｆｒｏｗ

    ｐａｒａｌｌｅｌｄａｔａꎬａｓｐｅｃｉａｌｃｏｎｖｏｌｕｔｉｏｎＳＲＡＭｍｅｍｏｒｙｉｓｄｅｓｉｇｎｅｄ.Ｔｈｅａｃｃｅｌｅｒａｔｏｒｉｎｔｅｇｒａｔｅｓｐｏｏｌｉｎｇａｎｄａｃｔｉｖａｔｉｏｎｕｎｉｔｓｉｎｔｏｔｈｅｄａｔａ

    ｐａｔｈꎬｅｆｆｅｃｔｉｖｅｌｙｒｅｄｕｃｉｎｇｔｈｅｔｉｍｅｏｖｅｒｈｅａｄｃａｕｓｅｄｂｙｒｅｐｅａｔｅｄｄａｔａａｃｃｅｓｓ.ＴｈｒｏｕｇｈＦＰＧＡｐｒｏｔｏｔｙｐｅｖｅｒｉｆｉｃａｔｉｏｎꎬｔｈｅｐｅｒｆｏｒｍａｎｃｅｏｆ

    ｔｈｅａｃｃｅｌｅｒａｔｏｒｃａｎｒｅａｃｈ９２.２ＧＯＰＳ＠１００ＭＨｚ.ＴｈｅａｃｃｅｌｅｒａｔｏｒｉｓｓｙｎｔｈｅｓｉｚｅｄｂａｓｅｄｏｎＴＳＭＣ１３０ｎｍｐｒｏｃｅｓｓ.Ｔｈｅｄｙｎａｍｉｃｐｏｗｅｒ

    ２

    ｃｏｎｓｕｍｐｔｉｏｎｏｆｔｈｅａｃｃｅｌｅｒａｔｏｒｉｓ３３ｍＷꎬｔｈｅａｒｅａｉｓ９０７６４.２μｍꎬａｎｄｔｈｅｅｎｅｒｇｙｅｆｆｉｃｉｅｎｃｙｒａｔｉｏｉｓ２７９３ＧＯＰＳ/Ｗꎬｗｈｉｃｈｉｓａｂｏｕｔａ

    ｈｕｎｄｒｅｄｔｉｍｅｓｈｉｇｈｅｒｔｈａｎｔｈａｔｏｆＦＰＧＡａｃｃｅｌｅｒａｔｏｒ.Ｔｈｅａｃｃｅｌｅｒａｔｏｒｈａｓｔｈｅｃｈａｒａｃｔｅｒｉｓｔｉｃｓｏｆｌｏｗｐｏｗｅｒａｎｄｃｏｓｔꎬｗｈｉｃｈｉｓｃｏｎｄｕｃｉｖｅｔｏ

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    －

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    面向微控制器的卷积神经网络加速器设计∗

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