1.函数将VerilogHDL模块中重复使用的代码段定义为子程序,既能够使描述代码具有更好的可阅读性、可维护性和可移植性,又能够减少出错的概率。VerilogHDL支持两种形式的子程序:函数(functions)和任务(tasks)。函数和任务既可以由系统定义,也可以由用户定义。函数是具有独立运算功能的单元电路,每次调用根据输入重新计算输出结果。在VerilogHDL中,函数定义以关键词function开始,以关键词endfunction结束。函数定义的语法格式为function[位宽]函数名;输入端口声明;语句1;
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